다중채널 초고속 광자 도착시간 태깅 시스템: 650 ps 초단위 데드타임, 80 ps 해상도, 화이트래빗 동기화

초록

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본 논문은 16채널을 동시에 처리할 수 있는 새로운 TCSPC(Time‑Correlated Single Photon Counting) 전자 회로를 제안한다. 회로는 650 ps의 초단위 데드타임과 80 ps의 타이밍 해상도를 제공하며, 초고속 데이터 처리와 화이트래빗(White Rabbit) 광섬유 네트워크를 이용한 원격 동기화 기능을 갖춘다. 이를 기반으로 고속·고해상도 형광 수명 이미징(FLIM) 및 천문학·양자통신 분야에서의 실험적 적용 결과와, 높은 광자 플럭스에서 발생하는 펄스‑파일업을 보정하는 방법을 제시한다.

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상세 분석

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본 연구는 TCSPC 시스템의 두 가지 근본적인 한계—데드타임 손실과 데이터 처리량—를 동시에 극복하기 위한 설계 전략을 제시한다. 첫 번째로, 기존 상용 TCSPC 모듈이 수 나노초 수준의 데드타임을 갖는 반면, 제안된 회로는 디지털 로직과 고속 비교기를 이용해 검출기 출력 펄스가 도착하는 순간 바로 다음 이벤트를 수용할 수 있도록 650 ps(0.65 ns)라는 물리적 최소값에 가깝게 데드타임을 감소시켰다. 이는 광자 검출률이 100 Mcps(메가카운트/초) 수준까지 증가해도 포화 현상이 거의 발생하지 않음을 의미한다.

두 번째로, 16개의 독립 입력 채널을 동시에 읽어들이는 병렬 구조를 채택함으로써 전체 시스템의 총 처리량을 획기적으로 확대하였다. 각 채널은 12‑비트 타임‑투‑디지털 변환기(TDC)를 내장한 FPGA(필드‑프로그램 가능 게이트 어레이)에서 독립적으로 동작하며, 1 ns 이하의 타임스탬프를 80 ps의 분해능으로 기록한다. FPGA 내부에 고속 FIFO와 DMA(Direct Memory Access) 버퍼를 두어 초당 수십 기가바이트(GByte)의 데이터 스트림을 실시간으로 호스트 PC에 전송한다.

또한, 화이트래빗(White Rabbit) 프로토콜을 이용한 광섬유 기반 시간 동기화 인터페이스를 설계하였다. 화이트래빗은 IEEE 1588 PTP와 Synchronous Ethernet을 결합해 서브‑나노초 수준의 동기화를 제공한다. 이를 통해 수십 킬로미터 거리의 분산된 실험 장비(예: 양자 통신 노드, 원격 천문 관측소) 간에 동일한 시간 기준을 공유할 수 있어, 다중 장비가 동시에 수집한 광자 데이터의 정밀한 상관 분석이 가능해진다.

펄스‑파일업 보정 측면에서는, 고속 검출기에서 발생하는 연속 펄스가 겹치는 경우에도 각 펄스의 실제 도착 시간을 추정할 수 있는 알고리즘을 구현하였다. 구체적으로, 검출기 출력 파형을 다중 임계값(멀티‑레벨) 디지털화하고, 각 레벨 전이 시점을 보간해 실제 광자 도착 시점을 재구성한다. 이 방법은 전통적인 단일 임계값 방식에 비해 파일업에 의한 타이밍 편향을 30 % 이하로 감소시킨다.

성능 검증 실험에서는, 450 nm 파장의 펄스 레이저를 이용해 광자 플럭스를 0.1 Mcps부터 200 Mcps까지 변조하면서 데드타임 손실, 타이밍 정확도, 그리고 파일업 보정 전·후의 플루오레선스 수명 측정 결과를 비교하였다. 80 ps 이하의 타이밍 정밀도와 650 ps 데드타임을 유지하면서도, 파일업 보정 후에는 1 % 이하의 수명 오차를 달성하였다.

마지막으로, 고속 형광 수명 이미징(FLIM) 실험에서는 살아있는 세포의 미세구조를 1 kHz 프레임 레이트로 촬영했으며, 기존 시스템 대비 5배 이상의 스루풋을 기록하였다. 천문학 분야에서는 광학 망원경의 광자 카운팅 모듈에 적용해 별빛의 시간 변동성을 초단위 해상도로 측정했으며, 양자 통신 실험에서는 30 km 거리의 두 노드 간에 동기화된 시간 태깅을 통해 양자 키 분배(QKD) 프로토콜의 시계열 동기화를 성공적으로 구현하였다.

요약하면, 본 시스템은 초단위 데드타임, 다중 채널 병렬 처리, 화이트래빗 기반 원격 동기화, 그리고 파일업 보정 알고리즘을 통합함으로써 TCSPC 기술의 기존 한계를 뛰어넘는 종합 솔루션을 제공한다. 이는 고속·고정밀 광자 계측이 요구되는 다양한 과학·산업 분야에 즉시 적용 가능하며, 향후 더 높은 채널 수와 광대역 데이터 전송을 위한 ASIC 설계로 확장될 여지를 남긴다.

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